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cpu:atomic

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cpu:atomic [2019/07/07 19:29]
oga
cpu:atomic [2019/07/07 21:08]
oga [x64 (relaxed/release/seq_cst)]
行 152: 行 152:
  ldrex r2, [r4]  ldrex r2, [r4]
  cmp r2, #0  cmp r2, #0
- beq .LBB0_18+ beq .LBB0_44
  clrex  clrex
- b .LBB0_19 + b .LBB0_45 
-.LBB0_18:+.LBB0_44:
  dmb ish  dmb ish
  mov r0, #3  mov r0, #3
  strex r1, r0, [r4]  strex r1, r0, [r4]
  cmp r1, #0  cmp r1, #0
- + beq .LBB0_53 
 +.LBB0_45:
 </code> </code>
  
行 168: 行 169:
  
 <code asm> <code asm>
- stlr wzr, [x19] 
- ldar w1, [x19] 
- adrp x0, .L.str.11 
- add x0, x0, :lo12:.L.str.11 
- bl printf 
  ldaxr w2, [x19]  ldaxr w2, [x19]
  cbz w2, .LBB0_18  cbz w2, .LBB0_18
行 211: 行 207:
  
 <code asm> <code asm>
 +.LBB0_47:
  ldrex r2, [r4]  ldrex r2, [r4]
  cmp r2, #3  cmp r2, #3
- bne .LBB0_24 + bne .LBB0_50
- mov r0, #0 +
- dmb ish +
-.LBB0_22:+
  strex r1, r0, [r4]  strex r1, r0, [r4]
  cmp r1, #0  cmp r1, #0
- beq .LBB0_25 + bne .LBB0_47 
- ldrex r2, [r4] + dmb ish 
- cmp r2, #3 + mov r1, #1 
- beq .LBB0_22 + b .LBB0_51 
-.LBB0_24:+.LBB0_50:
  clrex  clrex
  mov r1, #0  mov r1, #0
  dmb ish  dmb ish
- b .LBB0_26 +.LBB0_51:
-.LBB0_25: +
- dmb ish +
- mov r1, #1 +
-.LBB0_26:+
 </code> </code>
  
行 262: 行 252:
  
 ===== load ===== ===== load =====
 +
 +==== x64 (relaxed/acquire/consume/seq_cst) ====
 +
 +<code asm>
 + movl (%rbx), %esi
 +</code>
 +
 +
  
 ==== ARMv7A (relaxed) ==== ==== ARMv7A (relaxed) ====
  
 <code asm> <code asm>
-        ldr    r0, .LCPI0_1+        ldr    r0, [r4]
 </code> </code>
  
 +==== ARMv7A (acquire/consume/seq_cst) ====
  
 +<code asm>
 +        ldr    r0, [r4]
 +        dmb    ish
 +</code>
  
-==== ARMv8.xA (seq_cst/acquire) ====+ 
 +==== ARMv8.xA (relaxed) ==== 
 + 
 +<code asm> 
 + ldr w1, [x19] 
 +</code> 
 + 
 + 
 +==== ARMv8.xA (acquire/consume/seq_cst) ====
  
 <code asm> <code asm>
  ldar w1, [x19]  ldar w1, [x19]
 +</code>
 +
 +
 +
 +
 +----
 +===== store =====
 +
 +==== x64 (relaxed/release) ====
 +
 +<code asm>
 + movl %ebp, (%rbx)
 +</code>
 +
 +==== x64 (seq_cst) ====
 +
 +<code asm>
 + xchgl %ebp, (%rbx)
 +</code>
 +
 +==== ARMv7A (relaxed) ====
 +
 +<code asm>
 +        str     r5, [r4]
 +</code>
 +
 +==== ARMv7A (release) ====
 +
 +<code asm>
 +        dmb     ish
 +        str     r5, [r4]
 +</code>
 +
 +==== ARMv7A (seq_cst) ====
 +
 +<code asm>
 +        dmb     ish
 +        str     r5, [r4]
 +        dmb     ish
 </code> </code>
  
行 281: 行 331:
  
 <code asm> <code asm>
- ldr w1, [sp, #8]+        str     w20, [x19]
 </code> </code>
  
  
 +==== ARMv8.xA (release/seq_cst) ====
 +
 +<code asm>
 +        stlr    w20, [x19]
 +</code>
  
  
cpu/atomic.txt · 最終更新: 2019/07/07 21:08 by oga